SE TIENE UNA CONFIGURACION DE HARDWARE CON UNIDADES DE PROCESAMIENTO (CTR0, CTR1) OPERADAS EN FUNCIO...

SE TIENE UNA CONFIGURACION DE HARDWARE CON UNIDADES DE PROCESAMIENTO (CTR0, CTR1) OPERADAS EN FUNCIONAMIENTO PARALELO MICROSINCRONIZADO QUE PROCESAN INFORMACIONES DE ATM. LAS UNIDADES ESTAN CONECTADAS POR EL LADO DEL ATM A UNA MATRIZ DE CONMUTACION (SN0, SN1) Y POR UNA INTERFAZ DE BUS (B - I) A UNA UNIDAD DE CONTROL CENTRAL, QUE SIRVE PARA LA EVALUACION DE LAS ESTADISTICAS DE ERRORES EXISTENTES EN LAS UNIDADES DE PROCESAMIENTO Y PARA LA SUPERVISION DEL FUNCIONAMIENTO SINCRONIZADO MEDIANTE LA COMPARACION DE LOS RESULTADOS DEL PROCESAMIENTO. LAS ESTADISTICAS DE ERRORES SE EMPAQUETAN EN CELDAS DE TRANSMISION DE ATM Y SE REALIMENTAN A TRAVES DE LA MATRIZ DE CONMUTACION A LAS DOS UNIDADES DE PROCESAMIENTO, PARA LLEGAR DESPUES POR LA INTERFAZ DE BUS A LA UNIDAD DE CONTROL. ASI SE EVITA LA INDICACION EQUIVOCADA DE UNA PERDIDA DE MICROSINCRONISMO CUANDO SON DIFERENTES LAS ESTADISTICAS DE ERRORES DE LAS DOS UNIDADES DE PROCESAMIENTO.

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